AD9680BCPZ-500

L'AD9680 est un convertisseur analogique-numérique (ADC), 14 bits, double, 500MSPS Le double cœur ADC présente une architecture en pipeline différentiel à plusieurs étages avec une logique de correction d'erreur de sortie intégrée. Chaque ADC dispose d'entrées large bande passante prenant en charge une variété de plages d'entrée sélectionnables par l'utilisateur. Une référence de tension intégrée facilite la conception. L'entrée analogique et les signaux d'horloge sont des entrées différentielles. Chaque sortie de données ADC est connectée en interne à deux convertisseurs abaisseurs numériques (DDC). Chaque DDC comprend jusqu'à cinq étages de traitement de signal en cascade : un traducteur de fréquence 12 bits (NCO) et quatre filtres de décimation demi-bande. Les DDC sont bypassés par défaut. Les applications typiques incluent les communications, la diversité multibande, les récepteurs numériques multimodes (3G/4G, TD-SCDMA, W-CDMA, GSM, LTE), les radios logicielles à usage général, les récepteurs satellite à bande ultralarge, l'instrumentation, les radars, l'intelligence des signaux (SIGINT), DOCSIS 3.0 Chemins de réception CMTS en amont Récepteurs de chemin inverse numérique HFC.

• Alimentation DC 1,25V, 2,5V et 3,3V
• Aucun code manquant et référence de tension ADC interne
• Plage d'entrée flexible de 1,46V p-p à 2,06V p-p (2,06V p-p nominal)
• Bande passante pleine puissance entrée analogique de 2Ghz utilisable
• Bits d'isolation/diaphonie de canal de 95dB et de détection d'amplitude pour une mise en œuvre efficace de l'AGC
• Entrée d'horloge différentielle, division d'horloge entière par 1, 2, 4 ou 8 et petit tremblement de signal
• DNL = ±0.5LSB, INL = ±2.5LSB, densité de bruit = -153dBFS/Hz à 500MSPS
• ENOB de 10.8 bits à 10MHz
• SNR 69.2dBFS et 69dBFS à fIN = 10MHz
• Boîtier LFCSP-EP 64 broches, Plage de température de -40°C à 85°C

Remarques

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